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全数字锁相环
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全数字锁相环路的组成与模拟锁相环路基本相同，即也是由相位检测器、环路滤波器和压控振荡器等基本部件构成，但这些部件全部采用数字电路。 全部采用数字电路、在数字锁相环路中，时钟源通常不直接受控，不同于模拟锁相环路中的压控振荡器直接受误差信号的控制，这将有利于提高环路的性能。

基于FPGA的全数字锁相环设计方案
基于FPGA的全数字锁相环设计方案
　　引言　　数字锁相环中的数字环路滤波器是由模数为K的可逆计数器构成。锁相环中可逆计数器的模数K越小，系统响应越快，捕捉时间越短;反之，K越大，系统响应越慢，捕捉时间越长。数字环路滤波器的作用在于提高环路相位校正的准确性，减少噪声对环路的干扰。虽然,在捕捉过程中K值较小，有利于加快锁定速度，缩短捕捉时间。但在环路锁定后的同步过程中，若K值......
FPGA 全数字锁...
2021-08-26
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一种新型带宽自适应全数字锁相环的设计方案
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　　摘要：本文针对传统锁相环所存在的锁相范围窄、环路带宽和控制参数固定、以及提高锁相速度与减小稳态误差相互制约等问题，提出了一种新型带宽自适应全数字锁相环的设计方案。该设计方案中的系统采用比例积分控制与自适应控制相结合的复合控制方式，其中自适应控制器可根据锁相过程的鉴频鉴相信息，自动调整数字滤波器的控制参数，实现对环路的实时控制。　　本方......
自适应控...
2020-09-25
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一种基于频率预测算法的快速锁定全数字锁相环
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　　摘  要：近年来，5G和物联网应用对片上系统时钟提出了新的需求。锁相环在片内发挥着重要的作用，以产 生不同的时钟源。这些新需求的主要关注点快速锁定、低功耗、低噪声和小面积。随着CMOS工艺的发展，模 拟锁相环的工作电压逐渐降低，其设计面临着巨大的挑战。根据市场需求，采用全数字锁相环(ADPLL)进行数 字设计，以减少设计时间和设......
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2020-07-17
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