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ad9361数据手册

来源：

2026-03-16

类别：基础知识

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AD9361数据手册详解

一、概述

AD9361是一款面向3G和4G基站应用的高性能、高集成度的射频（RF）捷变收发器。它集成了RF前端与灵活的混合信号基带部分，同时集成了频率合成器，为处理器提供可配置数字接口，极大地简化了设计导入流程。该芯片工作频率范围为70 MHz至6.0 GHz，这一范围涵盖了大部分特许执照和免执照频段，能够满足多种无线通信应用的需求。其支持的通道带宽范围从不到200 kHz至56 MHz，可灵活适配不同的通信标准。AD9361具备出色的性能指标，在无线通信领域有着广泛的应用，包括点对点通信系统、毫微微蜂窝/微微蜂窝/微蜂窝基站以及通用无线电系统等。

二、芯片特性

（一）射频性能

工作频段：接收器本地振荡器（LO）工作频率范围为70 MHz至6.0 GHz，发射器LO工作频率范围为47 MHz至6.0 GHz。这种宽频段覆盖能力使得AD9361能够适应多种通信频段的要求，无论是低频段的长距离通信还是高频段的短距离高速通信，都能提供稳定的射频性能。
噪声系数：在800 MHz LO时，接收器噪声系数低至2 dB。出色的噪声性能有助于提高接收信号的质量，降低信号失真，从而提升通信系统的可靠性和稳定性。
发射误差矢量幅度（EVM）：发射器采用直接变频架构，可实现较高的调制精度和超低的噪声，TX EVM数值小于 -40 dB。较低的TX EVM意味着发射信号的调制质量更高，能够减少信号在传输过程中的失真，提高通信系统的容量和覆盖范围。
发射噪声：TX噪声小于 -157 dBm/Hz本底噪声。低发射噪声有助于减少对周围通信系统的干扰，提高通信系统的兼容性和共存性。

（二）信号处理能力

模数转换器（ADC）：每个接收通道搭载两个高动态范围ADC，先将收到的I信号和Q信号进行数字化处理，然后将其传过可配置抽取滤波器和128抽头有限脉冲响应（FIR）滤波器，结果以相应的采样率生成12位输出信号。高精度的ADC能够准确地捕捉接收信号的细节，为后续的数字信号处理提供高质量的数据。
数模转换器（DAC）：发射通道中的DAC同样具备高精度特性，可调的采样速率能够满足不同通信标准对信号发射的要求。DAC将数字信号转换为模拟信号，并通过一系列的滤波和上变频处理，最终将信号发射出去。
数字信号处理：AD9361集成了数字下变频器（DDC）和数字上变频器（DUC），以及高性能的数字信号处理器（DSP）单元。DDC负责将接收到的射频信号降频到基带，并进行数字滤波和抽取处理；DUC则将基带信号升频至射频，并进行插值和滤波处理。DSP单元对信号进行进一步的处理，如增益控制、直流失调校正、正交校正等，以确保信号的质量和稳定性。

（三）控制与接口

控制接口：AD9361通过一个标准四线式串行端口和四个实时输入/输出（I/O）控制引脚进行控制。用户可以通过串行端口对芯片内部的寄存器进行配置，设置工作模式、增益、频率、带宽等参数。实时I/O控制引脚则用于实现手动增益控制、收发切换控制等功能。
数据接口：提供可编程的数据接口，支持单通道12位并行数据端口、双通道12位并行数据端口或12位低电压差分信令（LVDS）接口，能够与各种基带处理器相连接。这种灵活的数据接口设计使得AD9361能够方便地集成到不同的通信系统中。

（四）电源与封装

电源要求：AD9361对电源要求极高，需要多达10组独立的电源域和相应的地，以实现良好的隔离和噪声性能。芯片核心可以直接用1.3 V稳压器供电，同时还有其他不同电压的电源引脚，如2.5 V或2.7 V的模拟电路电源、1.5 V的数字核心电源、1.8 V的I/O电路电源等。在设计PCB时，必须使用高性能LDO或开关电源 + LDO方案，并且每路电源都需要良好的去耦（电容靠近引脚），以确保电源的稳定性和低噪声。
封装形式：采用10 mm × 10 mm、144引脚芯片级球栅阵列封装（CSP_BGA）。这种封装形式具有体积小、引脚密度高的特点，能够满足现代通信设备对小型化和高集成度的要求。

三、功能模块详解

（一）接收器模块

射频前端：接收器射频前端包含低噪声放大器（LNA）、匹配相内I和正交Q放大器、混频器和频带整形滤波器。LNA用于放大接收到的微弱信号，同时尽量减少引入的噪声；匹配相内I和正交Q放大器确保信号的正交性，提高信号的解调性能；混频器将射频信号下变频到中频或基带；频带整形滤波器则对信号进行滤波，去除不需要的频率成分。
自动增益控制（AGC）：每个接收子系统都拥有独立的AGC功能，能够根据接收信号的强度自动调整增益，确保输出信号的幅度稳定。AGC系统可以实时监控接收信号的强度，并通过反馈机制调整增益，从而避免信号过载或过弱的情况发生。
直流失调校正：在直接变频接收器中，直流失调是一个常见的问题，会导致信号失真。AD9361的接收器模块具备直流失调校正功能，能够自动检测和校正直流失调，提高信号的质量。
正交校正：正交信号的不匹配会导致信号解调错误。接收器模块中的正交校正功能可以对I和Q信号进行校正，确保它们的幅度和相位匹配，从而提高信号解调的准确性。
数字滤波：接收到的信号经过ADC数字化后，会通过可配置抽取滤波器和128抽头FIR滤波器进行数字滤波处理。抽取滤波器用于降低信号的采样率，减少数据量；FIR滤波器则用于进一步滤除噪声和干扰，提高信号的信噪比。

（二）发射器模块

数字上变频（DUC）：从基带处理器收到的数字数据首先进入DUC模块。DUC通过插值、数字滤波和正交混频等步骤，将基带信号升频至射频。插值过程用于增加信号的采样率，数字滤波器用于形成信号频谱，正交混频则将信号调制到载波频率上。
数模转换（DAC）：经过DUC处理后的数字信号进入DAC模块，被转换为模拟信号。DAC具有可调的采样速率，能够满足不同通信标准对信号发射的要求。
射频前端：发射器的射频前端包含模拟滤波器、上变频混频器和输出放大器。模拟滤波器用于去除DAC输出信号中的采样伪像和杂散信号；上变频混频器将基带模拟信号重新组合，并在载波频率下进行调制；输出放大器则将调制后的信号进行放大，以达到足够的发射功率。
发射功率监控：板载发射功率监控器可以用作功率检测器，实现对TX功率的高精度测量。监控器输出可以通过一个未使用的接收器通道将其送回基带处理器，以实现信号监控和功率调整。

（三）频率合成器模块

AD9361集成了完全集成的锁相环（PLL），可针对所有接收和发射通道提供低功耗的小数N分频频率合成。PLL能够生成精确的本地时钟信号，为信号转换、数字滤波器和I/O端口提供时钟源。其最大本振（LO）步长为2.4 Hz，能够实现高精度的频率调谐。此外，AD9361还支持多器件同步，通过同步时钟差分输入（SYNCI_N, SYNCI_P）和同步时钟差分输出（SYNCO_N, SYNCO_P）引脚，可以实现多个AD9361芯片之间的同步工作，满足大规模通信系统的需求。